- 2024-11-23 - 行业知识
无论是做嵌入式硬件工程师，还是做嵌入式软件工程师，示波器的使用都能算得上是必备技能了，因为我们在做一些牵扯到时序的项目时，遇到一些问题，看是看不出来的，用示波器抓波形往往更直观一些。恰好手头一个项目用到了SN74HC164PWRG4 串转并8位输出移位寄存器，这里以此为例讲下如何调试波形。
图1是该芯片管脚图，A,B是与非门输入端，Qa~Qh是8位并行输出端，CLR是清除寄存器内数据，CLK是时钟管脚。
从图2能够准确的看出QA=!!(A&B)=A&B，QB=!!QA=QA，即若B=1，则QA与A逻辑关系保持一致，另外QH是第一个时钟时的数值，QA是第八个时钟时的值。
图4是项目中的实际接法，用IO口1作为芯片唯一的数据输入端，IO口2模拟时钟输入端，输出端只用到了QA~QD(LED灯，低电平点亮)。
/*参数高四位表示QA,QB,QC,QD,QA为最高位，为符合人的习惯，点亮将相应位置一就行*/
上面那个代码是结合真实的情况写的，对应波形看着不太协调（但是仅仅是看着不太协调，没有一点问题），调用led(0xa0)，输出的8位应该是0101 1111,又因为是先发低位，所以按时序实际是1111 1010，看懂应该没问题，下面截图，黄色是时钟，蓝色是数据
看上图，从左至右，箭头处对应的是8个时钟上升沿，看相应时刻的数据电平 1111 1010，和算的一样，没毛病，下面以第8个时钟沿为例，分析下代码中三个延时的作用。
结合上面代码分析，本来在第七个时钟的下降沿拉低之后，延时10us,蓝色高电平拉低，然后去掉delay_1时，在时钟拉低瞬间，数据切换蓝色电平拉低，瞬间觉得波形不好看了有木有（主要是不好分析波形了）。
看红色箭头这里，本来蓝色电平拉低之后延时10us，时钟才拉高，结果去掉之后，蓝色电平拉低瞬间，时钟拉高，这时候波形更不协调了，那么delay_1和delay_2都去掉呢？
可以看到去掉delay_3之后，每一次移位，时钟先拉低，然后完成数据切换，时钟拉高，但是拉高不做保持，瞬间拉低进行下一次移位，相当于时钟波形的高电平端被截掉了。
总结本篇文章目的是给一个案例，一是如何从波形分析数据，二是如何设置合理的延时时间，从而使展现的波形更加有助于分析。
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